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  • 隨著(zhù)人工智能在各行各業(yè)應用的興起,對計算機硬件算力的要求也呈爆炸式增長(cháng)。由于A(yíng)I算法對于處理器的運算并行性能有著(zhù)極高要求,因此常規的CPU中的少核心長(cháng)指令集的形式已經(jīng)不能滿(mǎn)足如今AI計算的要求。顯卡GPU由于其中有上百個(gè)核心,對于A(yíng)I算法中的乘加運算有著(zhù)更高的計算效率。但是由于GPU運算依然基于數字電子電路,對于超大AI模型來(lái)說(shuō),其中的數字式乘法器加法器基于多個(gè)場(chǎng)效應晶體管的結構依然具有高功耗的缺點(diǎn)。
  • CMOS邏輯電路的設計要經(jīng)過(guò)邏輯設計、電路設計、和版圖設計的過(guò)程。通常首先進(jìn)行邏輯設計以得到需要的邏輯。在CMOS電路中,一個(gè)邏輯通常由PMOS和NMOS組合實(shí)現,因為PMOS/NMOS對只在電平轉換的瞬間有電流消耗,這對于大規模集成電路的功耗是大有幫助的
  • 模擬集成電路中,各放大器支路均基于電流鏡框架,以保證穩定運行。電流鏡可理解為一系列具有電流比例關(guān)系的恒流源,而恒流源相較恒壓源具有串聯(lián)無(wú)衰減的特性。因此在一個(gè)恒流源支路中可串聯(lián)多個(gè)晶體管以實(shí)現功能,如利用多個(gè)場(chǎng)效應晶體管疊加提高輸出電流和擺幅等。模擬集成電路中常常有不止一級放大電路,各級放大器在電流鏡的支持下處于工作點(diǎn)并不受輸入信號電壓的影響。